基于FPGA的SOPC嵌入式数字频率计的设计与研究
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基于FPGA的SOPC嵌入式数字频率计的设计与研究(中文2000字,英文PDF)
摘要：本文提出了一种基于可编程芯片系统的SOPC嵌入式数字频率计的设计方案。设计采用Cyclone系列的FPGA为核心，嵌入8051 IP核作为MCU，完成系统频率的产生和检测。数字频率计系统使用Bresenham算法产生指定频率并使用测量频率和周测量的测量方法来完成频率测量。频率确定的范围是0.1Hz-10MHz。整个系统设计小型化，采用单片机完成系统的主要逻辑功能。该系统运行稳定，对于SOPC技术在工业设计中的应用起着重要作用。
关键词：SOPC，数字频率计划，8051 IP核。
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